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System Generator for DSP 包含对数字通信实验有用的模块集。某些模块是作为从 ISE Foundation 的 Core Generator 生成的 IP（知识产权）核而在硬件内部实现的，用于实现最佳结果。选定的 IP 核必须得到许可。了解各个模块的完整说明，请参照 System Generator 用户指南。

System Generator for DSP 还包含一套免费的参考设计。下表列出了一些对数字通信有用的实例设计。

参考设计
产品名称/型号	说明
16-QAM 解调器	该设计实现了用于软件定义无线电的均衡 16-QAM 解调器。接收器架构提供的子系统演示了随机 QAM 数据源上的自适应通道均衡和载波跟踪功能。
具有包成帧和 FEC 功能的 QAM 系统，可以用于遥测通道	该设计实现了具有包成帧和 FEC 功能的 QAM 系统，可以用于遥测通道。该系统是根据空间数据系统咨询委员会遥测通道编码规范（CCSDS 101.0-B-5）提供的指标实现的。
针对 DVB 标准的级联 FEC 编解码器	该设计演示了利用 Xilinx 通信库中提供的模块实现的级联前向纠错机制。该机制是根据欧洲电信数字视频广播标准（ETS 300 421）提供的指标实现的。
边环载波恢复
MIMO 通道模型仿真	该设计演示了多输入多输出（MIMO）通道模型。模型参数基于具有平衰落的四元线性发射和接收阵列。数出范围表明了时域通道响应（实数、虚数、量级和相位）。
SISO 通道模型仿真	该设计演示了单输入单输出（SISO）通道模型。模型参数是从 3GPP 技术规范 25.104 附录 B.2 - 多通道衰落传播条件（例4）得到的。输出范围表明了通道响应。注意：通道具有快和慢两种衰落方式。
用于 GSM 的数字下变频器	实际上，各种数字接收器均是利用数字下变频器（DDC）来执行通道接入的。利用由乘法器（M1 和 M2）和直接数字综合器组成的数字混合器来将预期的通道转换成基带。然后调整信号的采样速率以便跟通道带宽相匹配。这是利用由1个 CIC 滤波器和2个多相抽取器组成的多级多速率滤波器实现的。系统内执行的功能有波形综合（DDS）、复杂乘法和多速率滤波。DDC 的总采样速率变化为 192。DDS 混合器信号具有 102dB 的无寄生动态范围（SFDR）。数据速率高达 165 MSPS，并且受 DDS 混合器性能的限制。

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Xilinx 应用指南涉及的专题从 FPGA 资源利用到应用实例。
下述链接提供了访问支持的 XUP 电路板器件系列的应用指南的直接路径

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DSP：用于实现最佳结果的设计在线预定
针对 XUP Virtex-II Pro 的 DSP 启蒙讲稿和实验练习

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大学	课程名称/编号
莱斯大学	ELEC433：数字通信实验

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